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회로 정격값의 차이는, 저항기 구성의 차이에서 기인한다.
또한, 실제 회로 정격값과 실제 회로 측정값의 오차는, 저항기의 오차에서 기인한다.
그러나 대체적으로 측정값이 이론값에 근접하므로, 이론적인 기댓값과 근사한 전류 분할 회로의
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실험 10. 전압분할 회로(무부하)
실험 18. 부하를 갖는 전압분할 회로
실험 19. 전압분할 및 전류분할 회로 설계
실험 16. 키르히호프 전압법칙(단일전원)
실험 17. 키르히호프 전류법칙
실험 21. 최대 전력전송
실험 22. 망로(網路)전
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분할기 설계 실험
이번 실험은 9V에서 3mA의 부하전류를 공급하는 회로를 직접 설계하는 실험이다.
먼저 pspice 프로그램으로 개략적인 회로도를 그려보았다.
전체 전압은 15V이며, 이 회로에서의 부하저항은 R3 이다.
회로에 흐르는 총 전류는 임
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회로
1. 실험 목적
(1) 전압분할 회로에서 부하가 전압 관계에 미치는 효과를 알아본다.
(2) (1)의 결과를 실험적으로 입증한다.
2. 관련이론
◈ 부하를 갖는 전압 분할 회로(voltage-diveder)
분할 회로망은 전류가 흐르는 부하에 전압을 공급하기 위
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회로(무부하)
실험 18. 부하를 갖는 전압분할 회로
실험 19. 전압분할 및 전류분할 회로 설계
실험 16. 키르히호프 전압법칙(단일전원)
실험 17. 키르히호프 전류법칙
실험 21. 최대 전력전송
실험 22. 망로(網路)전류를 이용한 망로해석
실험 2
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