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주파수를 얻은 것을 확인할 수 있었다.
그림 4.10 데이터 입력을 통한 최종 PLL 모듈의 출력 주파수
제 5 장 결 론
본 논문에서는 높은 주파수, 빠른 lock time, 고해상도를 갖는 주파수 합성기를 DDS를 이용한 PLL 모듈을 이용하여 설계 및 제작 하였
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탕으로 두 입력 신호를 논리‘0’으로 리셋 시키는 구조를 사용함으로써 Up과 Down신호가 충분한 시간동안 논리‘1’의 값을 유지할 수 있도록 설계하였고 이에 따라 위상주파수 검출기가 NAND 게이트의 문턱전압에 상관없이 동작하게 함으로써
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설계검증 하였다. 25000컬러구현을 목적으로 한 Digital controller이나 직접적으로 OLED를 통하여 검증을 하지 못하였으나, 입력값과 결과값의 확인을 통하여 필요한 부분만을 설계하여 chip 및 처리속도에서 만족할 수 있는 데이터를 갖도록 하였다.
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- 발행일 2008.05.20
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설계”, 시그마플러스, (2001).
8. 손동욱, “신 정보통신 개론”, 생능출판사, (2001). 제1장. 서론
제2장. 본론
제1절 CDMA 이론
1. CDMA 개요
2. 다중접속기술과 CDMA
3. CDMA 네트워크 구성
제2절 TDMA 개요
1. TDMA란
2. TDMA의 성능
제3절 CDM
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설계”, 시그마플러스, (2001).
8. 손동욱, “신 정보통신 개론”, 생능출판사, (2001). 제1장. 서론
제2장. 본론
제1절 CDMA 이론
1. CDMA 개요
2. 다중접속기술과 CDMA
3. CDMA 네트워크 구성
제2절 TDMA 개요
1. TDMA란
2. TDMA의 성능
제3절 CDM
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