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끝날 때 기분이 너무 좋았다. 앞으로도 이론을 잘 알고 정확한 실험을 하도록 노력해야겠다. ○ 순서 논리 회로
○ 플립플롭(Flip-flop, FF)
● 가상실험
● 클럭은 인가하는 방법
●실험 보고서
● 문제
● 고찰
● 비고 및 고찰
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확인할 수 있습니다.
실험 (4)는 클럭을 주면 우측으로 쉬프트되는 구조의 쉬프트레지스터인데 실험시작 후, clock 시간 후에 출력 A에 1이 입력되어 A->B->C->D->A 순으로 1이 순환되는 것을 확인할 수 있었습니다. 실험
비고 및 고찰
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D에 각각 0, 0, 1, 1의 값이 출력되는 것을 알 수가 있다. 따라서 이번 실험의 회로도와 실험결과를 토대로 이 실험은 참이라는 것을 알 수가 있다. _
수고하셨습니다_ 1.D 플립플롭(D Flipflop)
2.D 플립플롭을 이용한 JK플립플롭
3.T 플립플
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플립플롭의 파형도는 J, K 및 시간 펄스에 따라 주종 플립플롭의 Q0와 Q에 대한 파형도를 나타낸 것이다.
그림 4-24. 주종 플립플롭의 파형도
주종 플립플롭은 JK 플립플롭의 단점인 J, K와 C가 모두 1일 때 출력이 게이트의 전차 지연 시간 주기로
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사용하여 만든다. 1. 가산 / 감산기
(1) 가산기
(2) 산술 연산기
① 가산기에 의한 산술 연산 회로
② 부호와 자리 넘침 판별 회로
③ 고속 가산 회로
④ 곱셈 회로
2. 플립플롭
(1) RS 플립플롭
(2) D(Data)플립플롭
(3) JK플립플롭
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