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D 래치 회로를 구성하고 입력 D와 의 변화에 따른 출력을 측정하라.
D
Q
0
0
0
1
0
1
0
0
1
1
5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.39 ~ p.54
③ 디지털 시스템 /
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회로 / 출판사-성학당 / 저자-이영준
④ 웹싸이트 - http://blog.naver.com/park8806?Redirect=Log&logNo=40037023409 실험관련 이론
1)래치
2)플립플롭
※플랩플롭 개요
래치와 플립플롭의 종류
1)비동기식(S-R)래치
2)동기식 S-R 래치와 S-R 풀리풀롭
3) D래
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실험은 래치를 이용한 되튐현상제거와 게이티드 D래치를 이용한 침입자 경보장치 그리고 D플립-플롭의 성질을 알아보는 실험이었다. 그래서 다양한 IC와 약간 복잡한 회로 구성으로 인해 우리는 디지털 공학책을 펴고 다시 공부 할 수 밖에 없
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완전한 D/A변환기이다. D/A변환기에서와 같이 A/D변환기에도 분해능, 비선형성과 같은 Spec이 사용된다. A/D변환기의 또 하나의 중요한 파라미터는 아날로그 입력을 디지털 출력으로 바꾸는데 걸리는 변환시간이다. ■ 실험목적
■ 실험이론
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Duty ratio =
※ R1 = 5K옴, R2 = 5K옴일 때, D = 66.6
④ 555 Timer의 주파수를 10kHz를 만드시오.
주파수 구하는 공식이
이므로,
f가 10kHz가 되려면 R1 = 약 4K옴, R2 = 약 5K옴이 되어야 한다. 1. 실험목표
2. 관련이론
3. 데이터 시트
4. PSpice 시뮬레이션
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