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REPORT
<8x1 MUX, 1X8 DEMUX>
1. 8x1 MUX
- 8X1 MUX 설계
EX) I 입력은 Bus switch로
S 입력은 Button Switch로
Y 는 LED로
entity MUX_LSI is
fort ( D : in STD_LOGIC_VECTOR(0 to 7); --BIT VETER 이라고 쓸 경우에는
S : in STD_LOGIC_VECTOR(0 to 2); --when others 안써도 됨 0과 1만 인식 가능함
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연결한 것과 같은 원리
-NAND 게이트의 표시기호는 AND 게이트의 표시기호 끝에 NOT
-게이트의 표시기호에서 따온 작은 동그라미를 붙여서 만듬
- 입력중 하나만 “0”이면 출력은 “1”
- NAND 게이트의 논리식은 AND와 NOT 게이트의 논리식을 결합
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0000000010000000\" => Segout7 <= \"1111111\"; --8
when \"0000000100000000\" => Segout7 <= \"1111011\"; --9
when \"0000001000000000\" => Segout7 <= \"1111110\"; --0
when \"0000010000000000\" => Segout7 <= \"1110111\"; --A
when \"0000100000000000\" => Segout7 <= \"0011111
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REPORT
< D플립플롭 >
1. D플립플롭
entity asdasd is
Port ( D : in STD_LOGIC;
clk : in STD_LOGIC;
CLEAR : in STD_LOGIC;
Q : out STD_LOGIC);
end asdasd;
architecture Behavioral of asdasd is
begin
process (clk, D)
begin
if clk\'event and clk = \'1\' then
Q <= D;
end if;
end process;
end Behavio
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실험의 주 개념은 순차 회로에 대한 개념이다. 순차회로에 대한 회로구성과 작동개념을 잘 숙지하고 예비보고서를 작성할 때 공부한 것을 바탕으로 실제 시험을 할 때 신속하고 정확하게 회로구성을 할 수 있도록 해야 하겠다. 1. 실험 목
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