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논리회로 실험, 생능출판사
이순흠 외 3명(2008), 웹기반 디지털 논리회로 가상실험실의 교육효과, 한국컴퓨터교육학회
오윤정(2005), 부울대수와 논리회로 학습을 위한 웹 코스웨어 설계 및 구현, 전남대학교
최수정(2004), 조합논리회로 학습을
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조합에 대하여 차와 빌림수의 논리함수를 얻기 위한 카르노 도는 그림 4-22과 같습니다.
표 4-9 전감산 진리표
A
B
C
D
Bn
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0
0
0
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0
0
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1
1
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0
1
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1
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0
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0
0
0
1
1
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1
1
그림 4-22 전감산 카르노(a) 차 (D)
ABC
00
01
11
10
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1
1
1
1
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(b) 빌림
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전기전자회로실험
- 실험6. 논리조합회로의 설계 -
1.개요
◎ 논리게이트 조합으로 복잡한 논리적 함수관계 구현 및 불필요하게 복잡한 논리를 단순화 시키는 K-map 응용 방법을 익히고 don’t care 조건을 다루는 예를 실습한다.
◎ 조
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변화 제 1장 컴퓨터와 디지털 논리회로
제 2장 데이터 표현
제 3장 논리 게이트와 부울 대수
제 4장 부울대수 간소화 및 구현
제 5장 조합 논리회로
제 6장 순서 논리회로
제 7장 레지스터와 카운터
제 8장 기억장치와 PLD
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조합 논리함수를 곱의 합 형식으로 만들어낼 수 있기 때문에 여러 개의 게이트를 하나의 멀티플렉스로 대체할 수 있다. 그래서 사용하는 게이트 개수를 줄이고 좀 더 쉽게 논리함수를 만들어 낼 수 있다. 또, 7세그먼트로 표시할 때도 사용될
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(4) XOR gate를 이용하여 보다 간소화된 다단계 조합 논리 회로를 설계하여라.
= + + + =
= + + +
= ( + ) + (+)
= () +
다단계 조합 논리 회로도
(5) 4-비트 가산기 회로를 위의 전가산기 회로를 이용해 설계하여라.
4-bit Adder 회로도 없음
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정리를 이용
Y=B+BC+ABC
=B+BC+BC+ABC
=B(C+)+BC(+A)
= B+BC
② 카르노 맵 이용방법
Y
AB
C
00
01
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10
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0
1
0
0
1
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1
1
0
Y= B+BC 1. 부울대수
2. 부울대수의 기본공리
3. 부울대수의 제반 정리
4. 조합논리회로
5. 카르노 맵(Karnaugh Map)
6. 간략화해보기
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저항을 앞에 달아주면 괜찮을 것 같았다. 다음실험에는 미리 회로구성과 핀번호같은 것을 충분히 숙지하고 실험에 임해야겠다. 디지털 공학 실험
6장 가산기와 ALU 그리고 조합논리회로 응용
결 과 보 고 서
1. 결과
2. 검토 및 고찰
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(c) NOT 게이트
입력
출력
A
B
Y
0
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1
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0
(d) NAND 게이트
입력
출력
A
B
Y
0
0
1
0
1
0
1
0
0
1
1
0
(e) NOR 게이트
입력
출력
A
B
Y
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0
0
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0
(f) Exclusive-OR 게이트
조합논리회로의 설계
우선 원하는
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논리 상태를 형성하는 구형파이다. 그림 1-8은 슈미트 트리거 회로의 기본 파형을 보여 주는 것이다.
그림 1-8 슈미트 트리거 회로의 기본 파형 슈미트 트리거 회로는 그림 1-9와 같이 두 개의 트랜지스터로 구성할 수 있다. 이 회로에서 한쪽
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