본문내용
nter와 state control counter에 reset signal을 만들어 주어야 하는데, 이 reset signal을 만드는 signal들은, interrupt signal과 state control counter의 한 state, 그리고 system 외부에서 들어오는 reset signal이 있다.
-truth table of reset signal
-timing of simulation of LOGIC WORKS
ASR과 BR의 timing에서 볼 수 있듯이 clock이 들어가고 signal이 clock에 의하여 동적으로 바뀌게 되면, propagation delay로 인하여 glitch 혹은 hazard가 생길 수 있다. 이 hazard는 하드웨어 설계에는 없을수 없는 변수 인데, 해결해야 할 문제에 따라서 꼭 없애야 하는 경우가 있고, 그냥 놔두어도 문제가 없는 경우가 있다. 그림에서의 glitch는 매우 짧은 시간동안 일어나고, 그 짧은 시간은 설계하려는 신호등에 아무런 영향을 주지 않는다. 사람이 느끼기에는 너무나 짧은 시간이기 때문이다. (glitch를 없애는 가장 좋은 방법은 flipflop으로 값을 catch하는 방법이다.)
-truth table of reset signal
-timing of simulation of LOGIC WORKS
ASR과 BR의 timing에서 볼 수 있듯이 clock이 들어가고 signal이 clock에 의하여 동적으로 바뀌게 되면, propagation delay로 인하여 glitch 혹은 hazard가 생길 수 있다. 이 hazard는 하드웨어 설계에는 없을수 없는 변수 인데, 해결해야 할 문제에 따라서 꼭 없애야 하는 경우가 있고, 그냥 놔두어도 문제가 없는 경우가 있다. 그림에서의 glitch는 매우 짧은 시간동안 일어나고, 그 짧은 시간은 설계하려는 신호등에 아무런 영향을 주지 않는다. 사람이 느끼기에는 너무나 짧은 시간이기 때문이다. (glitch를 없애는 가장 좋은 방법은 flipflop으로 값을 catch하는 방법이다.)
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