|
1
0
0
0
1
1
0
1
1
0
1
1
0
1
0
1
1
1
0
1
검토 실험 결과를 토대로 이 회로가 전 감산기로 동작함을 확인하여라.
입 력
출 력
X
Y
B
D
Bout
0
0
0
0
0
0
0
1
1
0
0
1
0
1
1
0
1
1
0
0
1
0
0
1
0
1
0
1
0
1
1
1
0
0
1
1
1
1
1
0
위의 실험의 논리식은 전 감산기의 논리식 D = XYB, BOUT = X(
|
|
|
논리 함수식 (위의 두 가지 식)을 동시에 구할 수 있는 반감산기는그림 4-21과 같이 설계할 수 있습니다.
그림 4-21 반감산기
(4) 전감산기
전감산기(FS : full subtracter) : 두 자리 이상의 2진수를 계산할 수 있는 회로입니다.
입력 변수를 피감수는 A,
|
|
|
감산기로 동작할 수 있도록 간단한 연산을 더하여 4비트 가 감산기를 구현하였으며 위의 파형과 예측하였던 결과 값이 동일하여 정상적으로 작동하고 있음을 알 수 있다.
느낀점
전가산기와 4비트 가산기 그리고 감산기는 논리회로시간에 배
|
|
|
감산기
IC 7483은 MSI 4비트 2진 전가산기이다.
다음 회로의 합 또는 차의 출력은 FPGA의 LED로 출력핀을 설정하여 FPGA의 LED로 출력을 확인한다.
그림 8-6의 Select 단자는 add 또는 subtract를 선택하는 단자임에 유의하시오.
표 8-6E와 표 8-7E의 2진수를 더
|
|
|
회로를 바탕으로 한 시뮬레이션과 쿼터스툴을 이용한 DE2보드 결과, 그리고 오실로스코프의 출력결과를 비교해보니 2digit의 숫자 간에 가산이 올바르게 행해졌다는 결론을 내릴 수 있었다.
실험4는 2digit의 가산기와 감산기 둘 다 가능한 회로
|
|
 |
회로”, 인하대 대학원 (2004) 석사 논문 , 국회도서관 DLL 석사논문 자료실.
<8> 류 영 수, 락킹 상태 표시기를 이용한 지연 고정 루프 기반의 클록 합성기 설계, 부경대 대학원 2006 석사 논문 , 국회도서관 DLL 석사논문 자료실.
<9> 백 동
|
|
|
논리과정을 설명하는 데 주안점을 두었으며, 후반부에 실제 사용한 회로도 및 프로그램을 수록하였습니다.
,
Ⅱ 본론
2.1 기본 원리
(1) 주차 시뮬레이션
1) 주차 공간에 대한 데이터를 로드 한다. (실제 구현의 경우 주차 공간에 대한 데이
|
|
 |
[프로그래밍및실습/A+] C 언어로 프로그래밍을 학습.
[전자회로및설계(1)/A+] 전자의 전반적인 이해와 기본적인 회로를 설계 하였습니다.
[공업수학/A+] 전기관련분야를 이해하기 위한 과정을 학습.
[디지털공학/A+] 순서논리회로의 분석 및 설계
|
|
 |
논리 회로 (Digital Logic Circuits)
□ 기본 논리 게이트(AND, OR, NOT, NAND, NOR, XOR, XNOR)의 진리표를 작성하시오.
□ 플립플롭(flip-flop)의 종류와 그 동작 원리를 설명하시오.
□ 레지스터와 시 <제목 차례>
? 이 자료를 구성하면서 읽어본 참고 문헌
|
|
 |
명확히 전달했고, 동시에 다른 부서에서 제기하는 요구사항과 피드백을 적극적으로 수렴했습니다. 특히 회로 설계 과정에서 발생한 제어 신호와 신호 무결성 문제를 해결할 때, 전기공학 담당자와 논리 설계자, 시제품 검증팀과 함께 머리를
|
|
 |
회로해석 자기소개서
1. LS산전에서 회로 해석 업무를 수행하며 본인이 가진 기술적 역량과 경험을 어떻게 활용할 계획인지 구체적으로 서술해 주세요.
2. 회로 해석 업무를 수행하는 데 있어서 본인이 갖춘 강점과 이를 통해 회사에 기여
|
|
 |
회로설계 Logic Design 자기소개서
1. 본인이 회로설계 분야에 지원하게 된 계기와 관련 경험을 구체적으로 서술하시오.
2. 논리 설계 과정에서 직면했던 어려움과 이를 해결한 방법을 설명하시오.
3. 팀 프로젝트 또는 협업 경험을 통해 얻은
|
|
메뉴펼치기
