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이해할 수 있게 해주는 좋은 실험이었던 것 같다. 3개의 입력이 들어갔을 때 8개의 출력 중 하나의 결과 값만 활성화 시켜서 출력하게 하는 논리회로임을 확인할 수 있었고, 소스 코드를 작성 과정(동작적 모델링)을 통해 Decoder의 동작 과정을
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디지털회로실험및설계 예비 보고서 #8
( Encoder, Decoder 실험 )
과 목
담당교수
제 출 일
학 번
이 름
1. 실험목표
① 인코더의 회로 구성과 동작을 실험한다.
② 디코더의 회로 구성과 동작을 실험한다.
2. 관련이론
인코더는 여러 개의 입력 중에
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따라 조금씩 부식이 일어날 수도 있기 때문에 내가 사용했던 브래드 보드 역시 이론에 가까운 완벽한 상태가 아니었을 가능성이 크기 때문에, 오차가 발생했을 가능성 또한 크다고 생각한다. 1. 회로도
2. 이론값
3. 실험결과
4. 결과분석
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논리를
포함한 counter의 설계라는 것을 잊은채 실험을 하였고 따라서 문제점이 그곳에 있었던
것 같은데 실험하는 상황에서 Preset과 Clear에 대해 전혀 생각하지 못했고, 그에 따라
실험 결과가 다르게 나왔다. 하지만, 이번 기회로 틀렸던 회
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실험 제목 : Shift Register
2) 목적
3) 관련이론(참고문헌)
레지스터
직렬전송
병렬 로드가 가능한 양방향 자리 이동 레지스터
자리이동 레지스터 (Shift Register)
링 카운터(ring counter)
존슨 카운터(Johnson counter)
의사불규칙 이진수열 발생기
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7-Segment Decoder/Driver이라고 부른다.
- 세그먼트 방식의 숫자 표시 소자로서 최대 7개의 세그먼트로 숫자를 표시하는 방식. 7개 모두 통전하면 8의 숫자가 된다. 이 실험에서는 7 세그먼트 디코더 드라이버와 7세그먼트 LED, IC동작에 대하여 실험 하
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5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.93 ~ p.104
③ 디지털 시스템 / 송상훈 외7명 / 인터비젼 / 2005
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74LS14를 사용.
- 슈미트 트리거 이론은 이동통신의 기지국간에도 이용.
ReSET 회로 .
1. RESET 회로를 만들어보고, 리 1. 슈미트트리거
2. Reset회로
3. Latch 회로
4. Rs232와 Rs422비교
5. 74HC573과 74HC574에 대한 비교 분석
6. ADDRESS Decoder 분석
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Encoder.avi)
5. Etc
Chapter 1에서의 BCD 덧셈에 대해서는 알고 있었지만 막상 회로를 그려서 BCD 덧셈에 대해서 나타내려 하니 어려웠습니다. 회로도에서도 마치 C언의 if 문과 같은 역할을 하는 논리 게이트를 구연해보니 신기하였습니다.
우선순위 E
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입력과 전 단계에서 발생한 자리올림수를 더하도록 구성
- 두 개의 반 가산기와 한 개의 논리합 회로를 이용하여 구성
- 자리올림수를 더해 줄 수 없는 반 가산기의 단점을 보완 1. GATES(AND, OR, NOT, XOR)
2. DECODER
3.MUX(Multiplexer)
4. ADDER
ADDER AND, OR, NOT, XOR, VHDL MUX(Multiplexer), [VHDL] GATES(AND, OR, NOT, XOR), DECODER, MUX(Multiplexer), ADDER,
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