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논리식을 실험을 통해 확인한다.
2. 실험 결과
3. 고찰
이번 실험은 논리 게이트인 AND, OR, NOT 게이트의 진리표와 논리식을 실험을 통해 확인해 보는 것이었다. 간단히 말해 AND GATE (논리곱회로)는 입력된 두 개의 조건이 모두 참(1)일 때만
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실력을 마음껏 뽐내주길 바란다.
예비조 실험 시 소자의 개수 파악 (6번실험:디코더/인코더)
1개조 당 7408=4개, 7432=2개, 7404=2개, 7447=1개,
7segment LED=1개, 일반 LED=3개 필요합니다. 1. 실험 목표
2. 실험 준비물
3. 실험 결과
4. 고찰
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결과 보고서를 쓰기 위해 전가산기와 전감산기, 2bit 병렬2진가산기를 만들어 각각 저장하고 각각의 컴파일과 웨이브폼으로 시뮬레이션을 해서 결과를 내 보았다. 그리고 그 결과를 그때 실험했던 결과 값과 비교해 보았다. 가끔 틀린 값이 있
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보고서
1. 작품구상
2. 구성작품의 동작
3. 블록도
4. 사용된 IC의 Data sheet 핀 배치도 및 펑션 Table
결과보고서
1. 작품 구성시 문제점
2. 작품의 실제 구성
3. 사용된 부품, 공구
4. Orcad Capture 프로그램으로 그린 회로도
5. 브레
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실험 4(a)에서:
(a) 게이트 G1의 입력을 A와 B로 나타내시오.
(b) 출력 X를 A와 B로 나타내시오.
(c) 출력 Y를 A와 B로 나타내시오.
(d)실험 결과를 기초로, X와 Y사이의 관계를 A와 B로 나타내시오.
4. 실험 4(a)에서 2개의 카르노 맵을 그리고 입력에 대한
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실험 1, 2, 3의 전가산기 실험값을 비교하시오. 여러분의 실험값을 논의하시오. 다음 회로에 대해 전가산기의 출력을 구하는 원리를 설명하시오.
(a) 실험 1과 2의 회로
(b) 실험 3의 회로
2. 실험 2에서 전가산기의 C0는 올바른 결과를 나타내었는
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실험 6의 내부연결과 파형패턴을 근거로 할 때 이 10 진 카운터 IC는 어떤 유형인가: SW출력, 1242, 또는 NBCD?
6. 실험 7의 파형패턴에 관하여 문제 5를 반복하시오.
7. 4bit-Synchronous counter를 설계하여 회로도와 파형으로 나타내시오. (simulation)
6. 필요
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2V/V 이상의 전압 이득을 갖는 차동 증폭 회로를 설계하시오.
- 실험을 시작하기 앞서서 사용할 저항들의 실제 측정값들을 멀티미터를 통해서 측정해보았다.
그 모습은 다음과 같았다. 1. 실험 과정 및 결과
2. 실험 결론 및 분석●고찰
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결과
◎ 사용한 기자재 및 부품 : DC 파워 서플라이, 디지털 멀티미터, 오실로스코프, 함수 발생기, 2N7000(NMOS) 4개, FQP17P10(PMOS) 2개, 브레드 보드, 전선, 저항 200kohm 1개 등.
2. 실험 결론 및 분석●고찰
(6) 능동 부하 차동 증폭 회로를 구성하
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회로 구성을 통해서는 PRBS 발생기를 구성했는데 실험 시 회로가 제대로 작동하지 않아 Logic Works 프로그램을 통한 회로 구성으로 실험 결과를 얻을 수 있었다. 위의 결과 값을 보면 초기설정이 1 1 1 1 이었고 그 후에는 불규칙적으로 클럭의 변
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