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TTL
TTL은 Transistor - Transistor Logic의 약자이며, 회로의 기본 구성이 트랜지스터만으로 이루어져 있다.
표준형, 저전력형(L형), 고속형(H형), 쇼트키형(S형), 저전력 쇼트키형(LS형)의 총 다섯 종류로 분류되며 쇼트키형은 advanced 쇼트키형(AS형),
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gn sum[31] = p[31] ^ c[31];
assign c_out = c[32];
endmodule
기본적으로 위의 내용과 비슷하다. sum[num]은 p[num]의 값과 캐리(c[num])를 더한 값의 출력임을 보여주고 있다.
c_out은 최상위 자릿수에서 발생하는 캐리값이다.
모든 실행이 끝나면, endmodule 키워드로
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어딘가가 끊어져 전류가 흐르지 못한다던지, 실험 1의 문제처럼 게이트의 Input과 Output을 담당하는 핀의 고장이과 같은 시스템의 하드웨어적인 문제일 가능성이 있는 것으로 추측된다. 실험 ①
NOT게이트 구성
실험 ②
1-bit full adder 설계
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기본화 또는 최대항(maxterm)
2.4. Sum of Product와 Product of Sum
2.5. 논리식의 간단화
2.6. 카르노도(Karnaugh Map)
2.7. 카르노도에 의한 논리회로의 간소화(간략화)
3. 실험 부품
3.1. 측정기 및 도구
3.2. 실험재료
4. 예비보고서 문제
5. 참고 문헌
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기본 회로 69
1. 실험 목적 69
2. 기초이론 69
3. 예비 보고서 74
4. 실험기자재 및 부품 76
5. 실험방법 및 순서 76
6. Simulation 78
7. 실험 결과 85
실험 8. Op-Amp 특성 측정 87
1. 실험 목적 87
2. 기초이론 87
3. 예비 보고서 91
4. 실험기자
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