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회로
(6) 그림4-9의 회로를 결선하고 입력 W, X, Y, Z의 변화에 따른 출력 F값을 측정하라.
그림4-9 간략화 회로
5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.29 ~ p.38
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회로를 만들어 보았다.
Input
Output
xa
xb
y0
y1
y2
y3
0
0
1
0
0
0
0
1
0
1
0
0
1
0
0
0
1
0
1
1
0
0
0
1
4. 실험에 필요한 이론
(1) 실험에 사용할 소자들의 Data Sheet
(2) 논리연산게이트
디지털 컴퓨터는 각 부품의 전기, 자기 특성상, 2개의 상태만을 표현하는 방법
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디지털 실험기판 위에 비동기식 카운트-업 카운터 회로 (a)를 구성하고 CLR을 0→1로 하여 모든 플립플롭들을 해제(clear)시키고 CLK에 클럭 펄스를 하나 씩 트리거시키면서 Q3~Q0의 논리상태를 측정하여 표 1(a)에 기록한다.
(2)비동기식 카운트-다운
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-Power Point
자료
-충분히 이해하는 지를 파악한다.
-평가 문제를
푼다. 대단원 : 디지털 논리 회로
소단원 : 1) 수의 표현
2) 2진-10진수 변환과 2진수의 사칙 연산
3) 기본 논리 소자
4) 논리 대수와 기초 논리 회로
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는 회로를 구성하기 위해 몇 개의 트랜지스트가 필요한가?
=>옆의 회로을 표준형의 AND,OR.NOT 게이트로 그리면 아래 와 같다.그리고아래의 트랜지스트의개수는 모두18개이다.
3.10 논리함수 f(X1X2X3X4)=m(0, 1, 2, 3, 6, 8, 9, 10)에 대해 CMOS 복합 게이트
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회로 결선하라.
그림1-6 OR 게이트 회로 결선
(3) NOT 게이트
- 그림1-7과 같은 NOT 게이트 회로 결선하라.
그림1-7 NOT 게이트 회로 결선
5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병기 / 喜重
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디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.125 ~ p.136
③ 디지털 시스템 / 송상훈 외7명 / 인터비젼 / 2005. 3. 28 / p.288 ~ p.293
④ http://blog.naver.com/jinaur?Redirect=Log&logNo=150009035765 1. 목적
2. 이론
3. 사용기기 및 부품정보
4. 실험과정 및
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회로를 구성한다
(5)Clear 입력에 0->1로 하여 Q1Q2=00으로 만든다.
(6)클록입력에 펄스를 주어서 Q1Q2의 상태표를 기록한다.
5.Reference
디지털 회로 실험 <한양대학교>
디지털 논리 회로 <John M. Yarbrough> 1.제목
2.실험 목적
3.관련
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논리 게이트이다. TTL은 논리 게이트의 표준이며, 대부분의 회사는 이를 기준으로 제품을 생산한다. 초기의 TTL은 ‘74 시리즈’이다. 74 시리즈는 성능이 개선되면 그 특징을 나타내는 문자를 덧붙이는 방식으로 개량되어 왔다. 74 시리즈는 쇼
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따라 조금씩 부식이 일어날 수도 있기 때문에 내가 사용했던 브래드 보드 역시 이론에 가까운 완벽한 상태가 아니었을 가능성이 크기 때문에, 오차가 발생했을 가능성 또한 크다고 생각한다. 1. 회로도
2. 이론값
3. 실험결과
4. 결과분석
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