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회로의 구성에 대한 패턴도를 완성하시오
9. 본 실험을 하면서 나름대로 배운점을 쓰시오.
오픈 컬렉터의 의미, 3-상태 버퍼/인버터 특성, 논리 게이트의 지연시간 특성에 대해서 알 수 있었다. 「실험 4」X-OR, X-NOR 게이트
실험 5
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예비보고서를 작성하려니 여간 곤욕스러울 수가 없었다. 하지만 예전 1차 예비보고서를 작성할 당시의 기억을 찬찬히 더듬으며 작성해 나갔다. 마침 이번에 2장은 다행히도 내용이 적어 수월하게 작성할 수 있었다. 이번 예비보고서를 작성하
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회로이다. 입력변화에 EK른 출력 X와 Y의 값을 측정하라.
그림3-11 개방 컬렉터 TTL NAND 게이트 결선회로
5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.17 ~ p.28
③ 디
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회로도 및 결과
- 부울대수와 카르노맵 실험
A
B
C
X
Y
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1
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- RS Flip-Flop 실험 (NOR게이트 사용한 S-R래치)
S
R
Q
Qvar
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X
X
- RS Flip-Flop 실험 (NAND게이트 사용한 S-R래치)
S
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회로를 가정하여 시뮬레이션 되었기 때문에 발생한 Delay로, 정상적인 현상이다.
4. 고찰
이번 실험은 디지털 회로를 만드는 데 있어서 가장 기본적이라고 할 수 있는 논리 Gate 회로의 구성에 대한 실험이었다. 우리가 일상생활에서 많이 접하게
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