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JK = 11일 때 상승에지에서 gate들의 천이상태를 timing diagram으로 그려서 동작을 설명하라(현재상태는 Q=1로 가정한다.)
B. IC 7476 master-slave JK 플립플롭의 내부 회로도를 그리고 클럭 펄스에 따른 동작을 timing diagram으로 그려라 래치와 플립플롭
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없는 것은 양의 에지 트리거 이고, 버블이 있는 것은 음의 에지 트리거이다. 이는 논리기호의 클럭 입력에 있는 작은 삼각형의 유무로 표시된다.
(9) 플립플롭의 응용에 관하여 설명하라.
플립플롭의 응용은 많다. 응용에는 레지스터, 주파수
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JK 플립플롭, T 플립플롭 등 여러 가지 종류가 있다. 비동기식 RS 플립플롭비동기 2진 카운터, 비동기식 10진 카운터, 동기식 2진 카운터, 직병렬 계수기
[참고 문헌]
- 디지털 논리 회로 분석과 설계
- 디지털 공학 실험
- http://sewoon.com/elect_data/inf
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)
Ⅳ. PR/CLR RS플립플롭(플립플롭회로)
Ⅴ. JK 플립플롭(플립플롭회로)
Ⅵ. 에지트리거 플립플롭(플립플롭회로)
Ⅶ. T 플립플롭(플립플롭회로)
Ⅷ. D 플립플롭(플립플롭회로)
Ⅸ. 주종 플립플롭(플립플롭회로)
참고문헌
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각각의 상태간에 입력에 따른 상태변화도를 그려서, FF을 선정하고 각 FF의 입력 함수를 결정할 수 있다. <기본플립플롭>
1.NOR 게이트로 된 SR 플립플롭
2.NAND 게이트로된 SR플립플롭
<래치(Latch)회로>
1.D 래치
2.JK 래치
3.T 래치
<마스
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