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저항의 관계를 더욱 잘 알게 되었다. 반비례,비례
관계가 뚜렷해지고 예비레포트에 썼듯이 분압기를 직접 다뤄보면서 경험을 늘렸다. 분압기를 사용해보면서 오차가 날 수 밖에 없구나 생각했고 미세하게 조절하는게 쉬운 일은 아닌 것 같았
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저항, 유도코일, 축전기로 구성된 RLC 병렬회로(실험기)를 PC(인터페이스)와 연결하여 자
동 실험 또는 수동으로 (내부)주파수를 가변하여 회로의 특성에 따른 공진주파수(진폭)를
확인한다. 목적
기본 이론
실험 기구 및 장치
실험 방법
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저항 RO는 클수록 바람직하며, 여기서는 RO=∞인 이상적인 정전류원을 가정. 입력: VI1,VI2출력: VC1,VC2
Chapter2. 실험 결과 (시뮬레이션)
PSpice 모의실험 - CH.8 차동 증폭기 회로
PSpice를 통해 주어진 회로를 구성하여 시간 영역(과도)해석을 수행하라.
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일정한 진동수의 교류전류가 흐르는 R-L-C 직렬회로의 임피던스를 구하고 그것을 이용
하여 공진주파수를 측정한다 실험 목표
실험 원리
실험 기구 및 장치
실험 방법
실험 결과
토의
추가 자료
참고 자료
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회로에서 부하저항 RL이 커진다면 이득은?
(a) 눈에 뛰게 증가한다. (b) 눈에 뛰게 감소한다. (c) 그대로이다.
⇒ Av=Vout/Vin=[ie×RE||RL)]/{ie×[r'e+(RE||RL)]}=(RE||RL)/[r'e+(RE||RL)]에서,
출력단의 부하저항의 값이 커지면 커질수록 Av의 Vout값이 Vin보다 훨씬 더
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에 기록한다.
- 옴의 법칙과 측정 저항값을 사용하여 각 저항기에 흐르는 전류를 계산하고
표11-1에 기록한다.
- 그림11-3에 나타낸 3개의 망로와 저항기의 정격값을 사용하여 망로 전류
를 계산하여 표11-1에 기록한다.
- 앞에서 구해진 값을 사
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2주차 Ch 10, 18, 19
3주차 Ch 16, 17
4주차 Ch 21, 22
5주차 ch 23, 24
6주차 ch 25, 26, 31, 33
7주차 ch 35, 37, 38
8주차 ch 42, 43, 44, 45
9주차 ch 46, 50
10주차 ch 47, 53
11주차 ch 46, 49, 52
12주차 ch 51, 54
13주차 ch 55, 56
실험 10. 전압분할 회로(무부하)
실험
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저항으로 전원 전압 분배
- 동작점 전류, 전압 값들이 와 에 직접적 영향을 받아 바이어스 안정 도가 좋지 않다.
- 전원 전압, 베이스-에미터 간 전압의 변동에 대해 안정도가 비교 적 높음.
- 신호에 대한 바이어스 회로의 손실이 작음.
- 전류
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의 드레인 포화전류는 라고 표시하며, , ,의 사이에서
의 관계가 성립된다. FET의 3정수인 증폭정수 μ, 드레인저항 , 상호컨덕턴스 은 다음과 같이 정의 된다.
Common Source의 경우에 대해서만 실험하며 CS에 대한 회로를 보면
<그림1. 소스공통 FE
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회로에서 위상각 대 주파수.
그림 6 입력 RC 회로에서 베이스 전압의 위상은 중간영역 주파수
이하에서 입력 신호전압의 위상보다 만큼 앞선다.
(5) 출력 RC 회로
그림 7 (a) 출력결합 커패시터 C3와
컬렉터 저항 RC및 부하저항 RL로 구성된 RC 회로.
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