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결과가 나오는지를 한 기능씩 확인하라. ■ 실험제목 : 산술논리연산장치
■ 관련이론
(1) ALU (arithmetic-logic unit) ; 산술논리 연산장치
(2) 산술 연산 장치
(3) 논리 연산 장치
■ 실험의 이론적 결과
(1) 예비보고서
(2) 실 험
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설계한 전가산기의 논리회로도는 그림 6과 같다.
예비보고서를 작성할 때, Max+Plus II를 사용하여 그림 6의 회로를 설계하고, 이 회로
에 대한 시뮬레이션 결과를 첨부하라.
그림 6 반가산기를 이용한 저가산기의 논리회로도
그림 6 시뮬레이션
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차이
○ 비동기식 계수기 (asynchronous counter)
● 가상실험
● 예비보고서
● 동기식 계수기
● 가상실험
● 결과 보고서
○ 비동기 계수기
○ 7진 리플 카운터 설계
○ 10진 리플 카운터 설계
●동기 계수기
●비고및 고찰
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예비 보고서 …………………………… 31
4. 실험 기자재 및 부품 …………………………… 33
5. 실험 방법 및 순서 …………………………… 33
6. 실험 결과 …………………………… 34
실험 5. 산술논리연산회로(1) ………………
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및 부품 23
5. 실험 방법 및 순서 23
6. 실험 결과 24
실험 4. 인코더와 디코터 26
1. 실험 목적 26
2. 기초 이론 26
3. 예비 보고서 31
4. 실험 기자재 및 부품 33
5. 실험 방법 및 순서 33
6. 실험 결과 34
실험 5. 산술논리연산회로(1) 35
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