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실험오차 범위내에 있다고 볼 수 있으므로 이번 실험은 비교적 성공적이라 말할 수 있겠다.
참고서적 : 전기전자실험 박건작 외/진영사
디지털회로실험 김사중 외/상학당
회로해석 교보문고
참고사이트 : http://163.180.122.191 경희대학교 광계측
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15-0까지 10진수로 감소하도록 나타내어라. (단, MyCad의 시그널 합치기...를 이용한다. 입력 CLK의 주기는 40ns이다.) ■ 실험목적
■ 실험이론
(1) 비동기식 카운터
(2) 동기식 카운터
(3) Up/Down counter
■ 실험준비물
■ 예비과제
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카운터는 1011에서 0000까지(11~0) 의 12 상태를 계수하고 반복된다.
CLR
0
0
0
1
0
1
2
1
0
CLK
0
0
0
0
1
0
0
1
2
0
1
0
3
0
1
1
4
1
0
0
4) 실험 순서
(1)디지털 실험기판 위에 비동기식 카운트-업 카운터 회로 (a)를 구성하고 CLR을 0→1로 하여 모든 플립플롭들을 해
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일시에 전송하는 방 법이다.
비동기(Asynchronous)
⇒앞에서 행해진 연산이 완료 되었다는 신호를 받고 비로소 특정한 연산이 시작된다 . 1.실험목적
2.동기와 비동기 정의
3.비동기식 카운터
4.동기식 카운터
5.비동기식&동기식 비교
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회로(Sequential logic circuit)
Ⅲ. 논리회로의 분류
1. NOT회로(回路)
2. AND회로(回路)
3. OR회로(回路)
Ⅳ. 논리회로의 명령
1. 마이크로 오퍼레이션(Micro Operation)
1) 동기 고정식
2) 동기 가변식
3) 비동기식
2. 메이저 스테이트(Major State)
1) Fetch
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asynchronous 중 어떤 관계에 있는가?
(10) 플립플롭 전송지연 시간이 50ns, gate 지연시간이 50ns일 때 실험 1회로의 최대 클럭 주파수를 구하라.
(11) 동기식과 비동기식 계수기의 차이점을 설명하라.
(12) 증/감계수의 동작원리를 설명하라.
(13) <
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비동기식 카운터(Asynchronous counter)의 원리를 설명하라.
(2) 비동기식 카운터의 장단점을 열거하라.
(3) 비동기식 카운터에서 클럭펄스의 주파수가 높아지면 어떠한 현상이 일어날 것인가를 예측하라.
(4) <그림 19.8> 회로에 대해 다음의 입력
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비동기식 MOD-10 카운터
2. 존슨카운터
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counter가 된다. 그 이유는 7476이나 7474가 negative edge trigger 이기 때문이다. 그러므로 회로를 설계할때 up counter을 만들고 싶으면 앞단의 Q값을 다음단의 clock로 입력해주면 되고 down counter을 만들려면 값을 clock에 연결해주면 된다. 실험목적
실
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2. 카운터 설계 개념 소개
3. 회로 구성 요소 및 기능
4. 아날로그 회로 설계 절차
5. 디지털 회로 설계 절차
6. 실험 방법 및 절차
7. 예상 결과 및 분석
8. 문제 해결 및 토의
9. 실습의 중요성과 응용
10. 결론 및 향후 연구 방향
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