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실험에 의해 얻어진 공진주파수의 값이 상당한 차이를 보였다. (오차:42.33%)
이는 조교님의 말씀대로 정확한 요인은 밝혀지지는 않았지만 각종실험계기들의 노후와 오류로 인해 발생되어진 것으로 추측된다.
이번 실험을 통해 RLC 병렬회로에
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실험을 통해 다시 임피던스의 개념을 복습 할 수 있는 유익한 시간이였다.
4. 참 고 자 료
① 일반물리학 / 이영재 외 9명 / 형설출판사
② 회로이론 / 김동희 외 2명 / 인터비젼
③ http://blog.naver.com/mpwqb91?Redirect=Log&logNo=40027330613
④ http://kin.naver.com
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회로를 만들어 보았다.
Input
Output
xa
xb
y0
y1
y2
y3
0
0
1
0
0
0
0
1
0
1
0
0
1
0
0
0
1
0
1
1
0
0
0
1
4. 실험에 필요한 이론
(1) 실험에 사용할 소자들의 Data Sheet
(2) 논리연산게이트
디지털 컴퓨터는 각 부품의 전기, 자기 특성상, 2개의 상태만을 표현하는 방법
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NPUT SIGNAL circuit block는 고정된 high와 low 신호의 두 출력을 공급한다.
.회로판에서 논리 회로는 DIP와 IC package를 포함한다.
EXERCISE 1-2 Connecting the Digital Logic Circuit
EXERCISE OBJECTIVE
디지털 논리회로를 연결하고 입력과 출력을 관찰하라.
DISCUSSION
.tow-pos
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회로를 결선하라.
2) 표 1의 결과가 나오는지 확인하라.
3) 논리연산회로를 결선하라.
4) 표 2의 결과가 나오는지를 확인하라.
5) ALU회로를 결선하라.
6) 표 3의 결과가 나오는지를 한 기능씩 확인하라. ■ 실험제목 : 산술논리연산장치
■ 관
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회로를 가지고 tc(0V ~ 0.949V 충전시간), td(1V ~ 0.368V 방전시간)를 측정하는 실험에서도 앞의 실험과 유사한 이유로 오차가 생겨버렸다.
마지막 실험으로 축전기 두개를 서로 직렬과 병렬로 연결하여 tc, td 를 측정하여 이론값과 비교해보는 실험
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디지털회로실험및설계 예비 보고서 #2
( 부울대수와 카르노맵, RS Flip-Flop 실험 )
과 목
담당교수
제 출 일
학 번
이 름
1. 실험목표
① 부울 대수로 논리식을 간소화하고, 실험으로 확인한다.
② 카르노 맵으로 논리식을 간소화하는 방법을 익힌
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회로도 및 결과
JK Flip-Flop 실험
실험1) 다음 회로도를 구성하고, 표를 완성하시오.
실험1 회로도
실험1 시뮬레이션
실험2) 다음 회로도를 구성하고, 표를 완성하시오.
실험2 회로도
실험2 시뮬레이션
실험3) 다음 회로도를 구성하고, 표를 완성
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선택하여 단일 출력으로 내보내 는 조합 논리회로이다. 멀티플렉서는 ‘n개의선택 (단자)변수’ 조합에 따라 많은 입력들 중 하나를 선택하여 그대로 출력에 넘겨주기 1. 실험 목적
2. 기초 이론
3. 실험 예비 보고
4. 실험 방법 및 순서
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회로가 정상작동함을 의미한다. 이로써 multisim 프로그램을 통해 간단한 회로를 구성하여 가상으로 사용해 볼 수 있었다. 2학년 1학기, 첫 전공 수업을 들으며, 과제들을 통해 여러 논리와 게이트들을 이해하고, multisim프로그램을 처음으로 이용
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