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디지털회로실험및설계 예비 보고서 #3
( JK Flip-Flop 실험, D, T Flip-Flop 실험 )
과 목
담당교수
제 출 일
학 번
이 름
1. 실험목표
① D 플립플롭의 회로 구성과 동작을 실험한다.
② JK 플립플롭의 회로 구성과 동작을 실험한다.
③ T 플립플롭의 회로
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실험4) 다음 회로를 구성하고, 표를 완성하시오. (D, T F.F 실험)
- 이론값
D
Q
Q\'
0
0
1
1
1
0
0
0
1
1
1
0
- 실험결과
D=0, Q=0 D=0, Q\'=1
D=1, Q=1 D=1, Q\'=0
D
Q
Q측정값
Q\'
Q\'측정값
0
0
0.15V
1
4.5V
1
1
4.5V
0
0.17V
0
0
0.15V
1
4.5V
1
1
4.5V
0
0.17V
결과분석
- D 플립플롭은 이
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실험을 통해 학생들은 다양한 유형의 Flip-Flop, 즉 SR, D, JK, T Flip-Flop의 특성을 분석하고, 이러한 Flip-Flop을 사용하여 순차 회로를 어떻게 설계하는지에 대해 배우게 된다. Flip-Flop의 각 1. Objective of the Experiment
2. Theoretical Approach
3. Verilog Imple
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Flip-flop의 동작을 이해하기 위해서는 그 기본 원리를 먼저 학습해야 하며, 특히 클록 신호(Clock signal)에 따라 상태가 전이되는 방식을 관찰하는 것이 중요하다. 클록 신호는 flip-flop이 언제 상태 1. 실험 목적
2. 실험 이론 및 원리
3. 실험
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설계하는 번거로움을 덜수 있
었고 앞으로 카운터를 이용할땐 플립플롭으로 카운터를 설계하는것 보다는 161소
자를 사용하는것이 간단함을 느낄수 있었던 실험이었다.
8. References
1. 참고문헌 및 사이트
1) 디지털 논리와 컴퓨터 설계 -M.Morris M
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