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실험제목: 전가산기,감산기 결과보고서
(결과보고서)
1. 예비조사 및 실험 내용의 이해
1.1 감산기란?
반가산기, 전가산기, 이진병렬가산기는 덧셈을 수행하는 반면, 반감산기,
전감산기는 뺄셈을 수행하는 회로를 말한다. 반감산기 회로에서는
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다른 회로의 전가산기를 구성하라. ●실험 목적
●실험 원리
○ 반가산기 (Half-Adder, HA)
○ 전가산기 (Full-Adder, FA)
○ 반감산기 (half subtracter , HS)
○ 전감산기 (full subtractor , FS)
● 결과보고서
○ 비고 및 고찰
○ 문제
○ 고찰
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보고서와 실험전 시뮬레이션 결과물과 실험 결과는 일치하였고, 이론적 지식을 실제 실험을 통해 증명할 수 있었다.
실험결과, 예비보고서와 사전 시뮬레이션을 통해 얻은 결과와 비교하여 보았을 때 가산기와 감산기(Adder & Subtractor)을 통하
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반감산기 회로를 구성하였다.
회로구성은 간단하게 하였고, Vcc=5V와 Gnd를 설정해 주었다.
Input
Output
x
y
B
D
0
0
33mV
32mV
0
1
4.97V
4.98V
1
0
33mV
4.97V
1
1
31mV
33mV
《반감산기 TRUTH TABLE & 측정값 & 카르노맵》
결과값은 예비보고서에서 조사한 이론값과 일
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반감산기 회로를 워크벤치로 돌려서 얻은 결과값은 다음과 같다.
- 입력 X, Y에 대한 B(Borrow)의 결과값
- 입력 X, Y에 대한 D(Difference)의 결과값
※ 워크벤치의 결과와 실험에 대한 결과가 일치하는 것을 확인할 수 있다.
(2) 예비 보고서 문제 3에서
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보고서, 삼성경제연구소 수석 연구원.
고용수·유재현(2006),「위안화 절상압력의 증대와 절상 가능성」,해외경제정보 제
006-71호 해외조사실 아주경제팀. 제Ⅰ장 서 론
제1절 연구의 필요성 3
제2절 중국의 통화와 환율제도 4
제Ⅱ장 본
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