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5. edge triggered D flip-flop
5.1. 두 개의 3입력 NAND gate (TTL 7410)를 이용하여 그림 3의 회로를 꾸
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Flip-Flop
1) Flip-Flop의 종류
ⅰ) Edge-triggered flip-flop
① Edge-trigger S-R flip-flop
② Edge-trigger D flip-flop
③ Edge-trigger J-K flip-flop
ⅱ) 비동기 입력
ⅲ) Master / Slave Flip-Flop
2) Flip-Flop의 동작특성
ⅰ) 전파지연시간
ⅱ) Set Time
ⅲ) Hold
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Edge-Triggered D Flip-Flops
⑤ 7476 - Dual J-K Flip-Flops with Preset and Clear 논리회로 실험 5. 인코더 (Encoder)
실험 1. 인코딩 - 10진 / Excess - 3 코드
실험 2. 7 segment 표시기를 갖는 BCD 카운터
논리회로실험 6. Latch & Flip Flop
(1) 예비과제 (1)에서 구한 R-
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플립플롭의 기억용량
2. 플립플롭의 개요와 동작
3. 타이밍관련 매개변수
준비시간과 유지시간
전달지연시간
최대 클럭주파수
4. 종류
SR 플립플롭 vs. D 플립플롭
JK 플립플롭 vs. T 플립플롭
Master-Slave 플립플롭 없음
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edge-triggered flip-flop and counter study, Microelectronics Journal, Volume 41, Issue 1, 2010, Pages 56-63. https://doi.org/10.1016/j.mejo.2009.12.008 목차
1. 서론
2. 본론
1) 에지트리거 플립플롭(D-, JK-, T-)의 진리표 및 특성 비교
2) 에지트리거 플립플롭(D-, JK-, T-)의 상
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