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VLSI report3.hwp
01.시스템 설계
≪ 그 림 ≫
4 to 1 MUX를 응용하여 산술연산과 비트단위 연산을 수행하는 시스템을 설계하였다.
이 시스템은 두 개의 4bit a 와 b. 3bit 선택 신호로서 8bit의 결과 c 를 출력한다. 주 기능은 산술연산 +, –
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프로그램 개발
제3세대
1960년대후반
~1970년대 중반
집적회로(IC)
200nsec
예측 의사결정
사무자동화
경영 정보 시스템의 도입과 CRT OMR MICR 등의 개 발
제4세대
1970년대 후반~현재
LSI,VLSI
400psec
사회
각 분야에 이용
운영체제의 발달 기종의 소형화
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단순비용
전력소비
구현복잡성
시장진입시간
성능
유연성
FPGA
낮음
높음
보통
보통
낮음
보통
높음
SOG
보통
보통
낮음
보통
보통
보통
보통
◎참고문헌 및 자료 출처
- Neil H.E Weste저, 백준기 역, CMOS VLSI설계원리, PEALRSON, 3판, 2005, pp.558-566
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72), "Characteristics of Organizational Environments and Perceived Environmental Uncertainty", Administrative Science Quarterly, Vol. 17, No. 2, pp. 313-327.
Economist (2001), "Business Blues", June 23.
Edquist, C. (ed.) (1997), Systems of Innovation-Technologies, Institutions and Organizations, Lon
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VLSI)
◎처리속도 순서 : 밀(ms)→마(ms)→나(ns)→피(ps)→페(fs)→아(as)
*ms(milli second) : 10-3sec 1/1,000
*㎲(micro second) : 10-6sec 1/1,000,000
*ns(nano second) : 10-9sec 1/1,000,000,000
*ps(pico second) : 10-12sec 1/1,000,000,000,000
*fs(femto second) : 10-15sec 1/1,000,000,000,000,000
*a
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