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단위-이득 플로워에 대해 생각해 보면,
그림.9 (a)단위-이득 플로워. (b)입력 계단 파형.
(c)V가 작을 때 관측되는, 지수적으로 상승하는 출력 파형.
(d)V가 클 때 관측되는, 선형적으로 증가하는 출력 파형
선형적으로 상승하는 출력 파형의 기울
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판단하였다. 그리고 가산증폭기에서는 실제로 그 값이 더해져서 나온다는 것을 볼 수 있었다. 선형 연산 증폭기 회로
1. 실험 결과 데이터
1)반전증폭기
2)비반전 증폭기
3)단위 이득 폴로워
4)가산 증폭기
2. 실험 결과 및 검토
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d. 오실로스코프를 사용하여 그림 28-8에 입·출력파형을 관찰하고, 그려라.
3) 단위 이득 플로워
a. 그림 28-9 회로를 구성하라. 입력신호 실효시 Vi = 2V(f=10kHz)를 인가하라. DMM을 사용하여 입·출력전압을 측정하고, 기록하라.
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단위 이득 팔로워 입출력 관계 유도식
- 위의 식은 앞서 유도했던 비반전 증폭기의 식이다.
- 전압 팔로워 회로는 Rf가 단락(0옴)되고, Rs가 개방(무한대)되는 비반전 증폭기 회로이다.
- 위의 식을 인용하면,
- 이렇게 되므로 Vout = Vin 이라는 결과
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1. 반전 증폭기
2. 비반전 증폭기
3. 단위이득 플로어(unity-gain follower)
4. 가산 증폭기(Summing amplifier)
5. 분석및 고찰
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