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논리회로 실습 보고서 - 가산기와 감산기
[1] 7486 IC와 7408 IC 핀 배치도를 참조하여 아래 회로를 구성한다.
▌검토▐
▌시뮬레이션▐
[2] 7486, 7408, 7404 IC 핀 배치도를 참조하여 아래 회로를 구성한다.
▌검토▐
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보고서 31
4. 실험 기자재 및 부품 33
5. 실험 방법 및 순서 33
6. 실험 결과 34
실험 5. 산술논리연산회로(1) 35
실험 6. 산술논리연산회로(2) 35
1. 실험 목적 35
2. 기초 이론 35
3. 예비 보고서 41
4. 실험 기자재 및 부품 43
5. 실험 방법
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보고서 …………………………… 31
4. 실험 기자재 및 부품 …………………………… 33
5. 실험 방법 및 순서 …………………………… 33
6. 실험 결과 …………………………… 34
실험 5. 산술논리연산회로(1) ………………………
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가산기의 논리회로도
그림 5 전가산기의 기능블럭도
한편, 전가산기는 2 개의 반가산기와 1 개의 OR 게이트로 구성할 수 있다. 그림 2의 반
가산기 기능블럭도를 사용하여 설계한 전가산기의 논리회로도는 그림 6과 같다.
예비보고서를 작성할
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회로이다.
입력변수 x,y의 차를 D, 빌려오는 수를 B라고 하면 아래와 같은 진리표를 작성할 수 있다.
회로는 다음과 같다.
반감산기 논리회로는 반가산기와 비교해보면 NOT게이트만 더 추가되었다는걸 볼 수 있다.
아래 사진은 실습시간에 만든
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