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설계 결과
A4 A3 A2 A1 = 1100
+
B4 B3 B2 B1 = 1100
CIN = 0
COUT SUM[1] SUM[2] SUM[3] SUM[4]
11000
▼ 진리표를 사용한 계산
0
0
0
0
0
0
0
1
1
0
0
1
0
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0
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1
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0
0
1
1
1
1
1
1
n = 1 : =0, =0, =0 진리표의 첫 번째 줄로부터 =0이고 =0
n = 2 : =0, =0, =0 진리표의 첫
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수 있었으나 분명 더 복잡한 회로를 다루게 된다면 이번 실험같이 주먹구구식으로 해결하지 않고 더 깔끔하고 교수님께서 원하시는 방향으로 회로를 vhdl로 구현할 수 있어야 한다는 점을 배웠다. 1. 개요
2. 디자인
3. 결론
4. 느낀점
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복잡하여서 여러번의 오차도 있었고, 많은 스위치와 LED를 사용하는 것 이였어서 실험이 계속 잘못 되기도 하였지만, 여러번의 실험을 통하여 더 정확히 확인 해 볼 수 있었다. ⓵ 7486 IC, 7408 IC 으로 구현한 가산기 회로
⓶ 7486 IC, 7408
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4비트 2진/Excess-3 코드 변환기를 설계하고 구현 및 테스트를 하며, 오버플로우 검출이 가능한 부호 있는 가산기를 설계하는 것이 주된 실험 목표였다.
처음에 2진/Excess-3 변환기의 회로도를 봤을 때 무엇인가 왠지 복잡 할 것 같았고 어려울 것
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VHDL 설계시에 많은 시간이 소요되었다. 물론 Graphic Editor를 사용할 때는 비교적 회로의 구현이 쉬웠다. VHDL의 설계에 관해서 더욱 더 노력을 기울여야 겠다.
이번 실험의 주가 되는 것은 가산기 이다. 계산기의 기본 구조와도 같아 보였다. 학기
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