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캐쉬메모리의 구조
1999. 3 연세대학교 전기공학과 이용석 교수님연구실 박사과정 정우경 1. 캐쉬메모리 탄생
2. 캐쉬메모리 구조 및 동작 방법
3. 캐쉬메모리의 크기, 블록 사이즈 및 성능
4. 캐쉬메모리 설계방법
5. 캐쉬메모리 리
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2. RAM(Random Access Memory)
3. ROM(Read Only Memory)
4. ROM BIOS
◈ 보조 기억 장치란?
◈ 보조 기억 장치의 종류
◈ 플로피 디스크 드라이브(Flopy Disk Drive)
◈ 하드 디스크(HDD:Hard Disk Drive)
◈ 광학 저장 장치(ODD:Optical Disk Drive)
◈ 캐쉬메모리란?
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넣어야하는 기술이 필요하게 됩니다. 그때까지 실리콘의 한계를 극복해서 클럭 주파수를 올리고 다시 싱글코어부터 시작하는 방법으로 될 것 같습니다. 서론
본론
i. moor`s law
ii. 무어 법칙의 한계
iii. cpu의 속도 발달 과정
결론
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동작
7.2 버스중재
7.2.1 병렬 중재 방식
7.2.2 직렬 중재 방식
7.2.3 폴링 방식
7.3 IO 장치의 접속
7.3.1 IO 제어
7.3.2 IO 주소 지정
7.4 인터럽트를 이용한 IO
7.4.1 다중인터럽트 선들을 사용하는 방식
7.4.2 데이지 체인 방식
7.4.3 소프트 웨어 풀링
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캐쉬
인텔의 펜티엄 4 프로세서는 새로운 첨단 Level 1(L1) 명령 캐시 기술로서, 보다 뛰어난 성능명령 캐시를 제공하는 Execution Trace Cache를 포함하고 있습니다. 이 Execution Trace Cache는 캐시메모리를 보다 효과적으로 이용할 수 있도록 합니다.
또
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