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P-Spice (A-회로)
1)
2)
3)
4)
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6)
7)
8)
P-Spice (A-회로)
9)
10)
11)
P-Spice (A-그래프)
1) 전압파형
1)전류파형
P-Spice (A-그래프)
2) 전압파형
2) 전류파형
2) 전압(AC SWEEP)
2) 전류(AC SWEEP)
3) 전압파형
3) 전류파형
3) 전압(AC SWEEP)
3) 전류(AC SWEEP)
P-Spice (A-그래프)
4)
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a)>
Vg: 붉은색 VR: 초록색
위에 피스파이스 자료는 실험(3)의 주파수를 각각 2배 시켜준 결과이다. 아래 실험(3)의 피스파이스 결과를 다시 옮겨보면 직렬 RLC 회로에서 주파수를 증가시켰을 때 어떤 결과를 갖는지 관찰할 수 있다.
실험 (3) <
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크게 나온 것으로 보인다.
< 4. 참 고 문 헌 >
- FUNDAMENTALS OF MICROELECTRONICS, RAZAVI, WILEY, 2008.
- 회로이론, James W.Nilsson·Susan A, Riedel, WILEY, 2006. < 1. 목 적 >
< 2. 이 론 >
< 3. 실험 과정 및 실험 결과 예상 (시뮬레이션) >
< 4. 참 고 문 헌 >
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공통 소스 증폭기 회로도
공통 소스 증폭기 시뮬레이션 1. 목적
2. 이론
(1) 증폭기로서의 FET
(2) 공통-소스 증폭기
(3) JFET의 바이어스
(4) 전압분배기와 소스 바이어스
3. 공통 소스 증폭기 회로도 및 시뮬레이션(피스파이스)
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회로입니다. 이 실험도 그 전의 실험들과 실험방법은 유사하였습니다.
완전한 5V, 0V가 출력되지 않는 오차가 발생한 이유는 전원공급기에 5V를 입력할 때 그 정확한 값은 5V가 아니었을 것이고 (함수발생기가 더 정확한 값을 보여줍니다.), 각 Ga
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