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실험 30 FET 증폭기 특성 시뮬레이션
실험 순서(3)에 의한 입력 및 출력파형
입력파형
출력파형
실험 순서 (5)
Rd를 4.7k로 바꾸었을 때 출력
Rd를 680으로 바꾸었을 때 출력
실험 순서(6)
R_G
를 10k로 바꾸었을 때 출력파형
R_G
를 1M로 바꾸었을 때
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증폭기를 설계해 보니 op-amp에 대한 호기심도 생겨, 여기서 머무르지 않고 여러 가지 회로에 대한 공부도 해 보고 싶다.
8. 참고문헌
(1) 전자회로 핵심 개념부터 응용까지 -저자 : 강문식, 신경욱
1) 6장 전계효과 트렌지스터(FET) 증폭기, 2) 7장 차
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30-3(b)는 드레인 공급전원을 이용하여 고정바이어스를 얻는 회로이다. 여기서
로 주어진다.
(2) 접지방식에 따른 특성
FET 가 증폭기로 사용될 때 이의 기본적인 접속방식은 소스접지(Common Source:CS),
그림 3 자기바이어스와 고정바이어스의 조합
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증폭기의 이득을 측정한다.
이론
(1) J FET의 구조
(2) J FET의 특성
(3) J FET의 동작
실험 방법
[실험 1 : 게이트 전압이 0V일 때(Vgs=0V)]
[실험 2 : 게이트와 역바이어스 걸렸을 때]
[실험 3 : 전달 특성]
[실험 4 : 자기 바이어스 공통-소스 증폭
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증폭기는 2개의 입력단자(+표시의 비반전 입력단자, -표시의 반전 입력단자)와 출력단자, 그리고 5~15v의 2전원을 필요로 하다.
(3) OP amp의 특징(characteristics)
OP amp나 소자의 특성을 이해하는 가장 좋은 방법은 제조회사에서 제공하는 특성표를 참
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