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4개의 일정한 간격으로 다른 출력을 낼 수 있었다. 이것을 이용하면 일정한 시간간격으로 작동하는 무언가를 만들어 실생활에 이용할 수 있을 것 같았다. ● 4-Phase clock 발생기
●예비 실험
●결과 보고서
● 실험
●고찰
●비고
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그리고 QB가 High로 출력된 구간 50~60ns에서는 Y2가 출력되었다. 마지막으로 QA와 QB가 Low인 구간 70~80ns에서는 Y0가 출력되었다.
이러한 원리로 작동한다는 것을 예비보고서를 쓸 때에는 몰랐지만 이번 실험을 통해서 알게 되었다.
1. 실험 결과
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되는 것을 알 수 있었다. 이를 확인하기 위해서 주파수를 1Hz를 바꿔 실험을 반복하였더니 1초마다 신호가 시프트 되는 것을 확인할 수 있었다. 1.목적
2.이론적 배경
3.사용 장비 및 부품
4.실험 방법
5.예비 보고 사항
6.결과 보고서
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4번(Speed) 는 사각파형을 쉽게 만들어 내었고, 회로도 쉽게 구성하였으나, 장비문제로 파형을 얻어내지 못해서 아쉬웠으나 조교님께서 DATA값을 보내주셔서 이해할 수 있었다. CMOS 회로의 전기적 특성
Logic Levels & DC Noise Margins
회로구성
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4. 실험방법 및 순서 8
5. Simulation 11
6. 주의사항 및 주요 관찰사항 16
실험 3. 트랜지스터 증폭기 실험 17
1. 실험 목적 17
2. 기초이론 17
3. 예비 보고서 21
4. 실험기자재 및 부품 21
5. 실험방법 및 순서 22
6. 실험결과 23
실험 4. F
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