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main file 에 대해서만 waveform을 비롯한 결과들이 simulation된다는 것을 이해했다.
8.참고문헌
(1) Fundamentals of Digital Logic with VHDL Design second edition, Stephen Brown, 2005
(2) http://cafe.naver.com/carroty.cafe
(3) http://blog.naver.com/nowcafe?Redirect=Log&logNo=20016488913
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(1) Fundamentals of Digital Logic with VHDL Design second edition, Stephen Brown, 2005
(2) http://princess.kongju.ac.kr/DigitalMain/dvlec/textbook/chap07/flash/dff.htm 1. 제목 : 4-Bit D Flip Flop 설계
2. 개요 :
3. 이론
4. 설계과정
5. 결과 및 분석
6. 토의사항
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4LS73 JK 플립플롭
≪ 그 림 ≫ 9장 예비 레포트.hwp………………………………………………………7p
아날로그 및 디지털 회로 설계 실습
-예비레포트-
10. 4-bit Adder 설계
1. 목적
2. 설계실습 계획서
전자신문.hwp………………
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회로
(b) 타이밍도
[그림 2] 2비트 동기 2진 카운터
[그림 3] 2비트 동기 2진 카운터의 상태 변이도
카운터의 종류,
비동기 카운터, 동기 카운터, 병렬 입력 2진 카운터, 링 카운터, 존슨 카운터
3. 참고 자료
디지털 논리와 설계, 유황빈 (정익사) 455-
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회로에서 CLK 와 SINPUT을 신호발생기로 구형파 값을 주었다.
<CLK 와 SINPUT 값>
B. Discussion
이번 실험은 D Flip-Flop 을 이용한 4bit Shift Register 회로이다.
D Flip-Flop 4개를 사용하고 D Flip-Flop의 Output값이 clk이 변할 때 마다 다음 D Flip-Flop의 Input값으로
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