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실험에서 우리는 시프트레지스터를 응용하여서 실제적으로 그 쓰임새에 대해서 알아보았습니다. 시프트레지스터는 그 목적이 레지스터이기 때문에 데이터 저장이 주목적이지만 시프트 기능을 갖추기 때문에 데이터 전송이나 수신에 아주
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플립플롭 부분에 대한 실험을 할 때 어느 정도 숙지했던 내용이었기 때문에 설계 과정에서는 큰 어려움이 없었다.
결과를 보면 이번 설계도 큰 오차 값은 발생하지 않았다. 값을 측정하는 게 아니라 파형을 도출해내는 것이기 때문에 오차를
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버리게 됩니다. 따라서 래치 회로는 입력 SR=11을 인가하지 않는다는 조건하에 사용하여야 합니다. 만약 래치가 nand 로 구성된 래치라면 00 을 인가하면 안됩니다.
Pspice의 예시 실험 목표
사용 부품
관련 이론
실험 순서
용어 정리
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1. 목적
가. 기억소자의 기본 원리를 이해한다. 나. 순차논리회로의 기본 소자인 래치와 플립플롭을 종류(RS, D, JK, T)별로 소개하고 이들의 기본 동작, 회로 구성 및 기능표를 이해한다.
2. 이론 디지털 회로는 조합회로와 순차회로로 구분할
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이번에는 래치와 플립플롭에 대해서 배우고 실험을 했는데, 디지털공학 수업을 듣지 않고 실험을 했더라면 정말 힘들었을 것 같은데 이론자체가 상당히 어렵고 래치와 플립플롭의 종류도 다양해서 많이 헷갈리기 때문이다. ◈ 실험 결과
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D
Qn+1
비고
0
X
Qn
불변
1
0
Qn
불변
1
1
n
반전
- 타이밍도 1. 그림 8의 4-bit even-parity generator/checker 실험회로를 결선하시오. D0, 1, 2, 3 입력에 1=H(5V) 와 0=L(0V)의 조합을 인가하고 Switch SW의 ON/OFF 상태에 따른 P와 Y를 측정하여 다음 표를 완성하시오.
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부지런히 해보자는 각오를 하고 다음 실험부터는 더욱 열심히 하겠습니다. 1. 실험제목
2. 조 / 반
3. 학번 / 이름
4. 제출일
5. 실험목적
6.실험 결과 및 토의사항
7. 실험에 대한 문제점과 개선 및 발전 방향, 실험에 대한 자신의 생각
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15-0까지 10진수로 감소하도록 나타내어라. (단, MyCad의 시그널 합치기...를 이용한다. 입력 CLK의 주기는 40ns이다.) ■ 실험목적
■ 실험이론
(1) 비동기식 카운터
(2) 동기식 카운터
(3) Up/Down counter
■ 실험준비물
■ 예비과제
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실험 제목 : Shift Register
2) 목적
3) 관련이론(참고문헌)
레지스터
직렬전송
병렬 로드가 가능한 양방향 자리 이동 레지스터
자리이동 레지스터 (Shift Register)
링 카운터(ring counter)
존슨 카운터(Johnson counter)
의사불규칙 이진수열 발생기
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디코더(Decoder)
인코더(Encoder)
순서 논리회로
입력값과 회로의 현재 상태에 따라 출력값 결정
기억능력 갖고 있음
플립플롭(flip-flop)
RS 플립플롭, D 플립플롭, JK 플립플롭, T 플립플롭
순서 논리회로
레지스터(register)
카운터(counter)
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