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디지탈 멀티미터를 이용하였다.
4> 회로의 구성은 Simulation의 회로와 같은 형태로 구현되었다.
실험1) NOT gate 실험
☞ 74LS04를 이용하여 회로를 [그림 1]과 같은 회로를 구성하고 실험하였다.
입력
오실로 스코프
디지탈 멀티미터
HI
LO
0.125 V
LO
HI
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을 기입한다. 예를 들면 첫 번째 회로의 U점에는, X점에는 A+B를 기입해야 한다.
그림 2-1
표 2-1
A
B
U
V
X
Y
Z
0
0
0
1
1
0
1
1
그림 2-2
표 2-2
A
B
W
X
Y
0
0
0
1
1
0
1
1
그림 2-3
표 2-3
A
B
U
V
W
X
Y
0
0
0
1
1
0
1
1
그림 2-4
표 2-4
A
B
C
U
V
W
X
Y
0
0
0
0
0
1
0
1
0
0
1
1
1
0
0
1
0
1
1
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논리식을 구한다고 가정하자.
PI 식별단계는 ① 문제에서 주어진 각 최소항(minterm)의 2진수 값을 차례로 쓰는 것으로부터 시작한다. ② 다음에는 최소항들의 2진수 값을 보고 1의 개수가 같은 것끼리 모아 섹션(section)을 만들고 각 2진수 값 옆
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회로를 완성하게 되어 최적의 Serial Adder를 구현한다. 기본적인 Shift Register와 Full Adder를 최소한의 Gate로 구성한다. 오류 및 입력에 따른 값이 정확히 나오는지 확인한다.
3. 수행 결과
기본적인 Shift Register에 And, Or Gate를 제거하고 Mux를 넣어서
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1. 논리게이트 IC의 종류 및 명칭 분류
2. 실험 기자재 & 용도
3. 실험의 고찰 및 응용분야
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논리식으로 간소화하여 논리도로 나타내시오.
3. 10진수 0에서 5까지에 대해 익세스-3 코드를 작성하고, 표 12-3R의 결과와 비교를 하시오. 이들이 서로 일치하는가?
4. 그림 12-7과 표 12-3R을 비교하고, 그림 12-7의 회로가 익세스-3 코드를 어떻게
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회로 구성 》
《 A/D CONVERTER 회로 구성 》
회로구성 실험1의 회로 출력에 위의 비교기를 부가한다 (uAl458C OP amp에는 2개의 OP amp가 있으므로 1개의 op amp로 회로를 구성할 수 있다).
1) 1KHz pulse를 single pulse로 바꾸고 (스위치 box를 사용) counter를 0으로
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1. 실험목적
가. 반가산기와 전가산기의 원리를 이해한다.
나. 반가산기와 전가산기의 설계를 통해 조합논리회로의 설계방법을 공부한다.
다. 상용 ALU(산술논리 연산장치)의 기능을 이해한다.
라. 상용화된 4비트 ALU를 이용하야 두 수의
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하면 아래와 같다. 입력 4개와 출력 3개로 회로가 매우 복잡하다.
- 인수들은 왼쪽 식과 같은 위치를 가진다. 따라서 이를 참고하여 실험 결과를
추측해 볼 수도 있다.
- 위의 실험에 대한 각각의 출력치를 측정하여 Truth table을 만들면 다음과
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R-S latch 구성 및 출력
실험 사진 첨부
예비회로 조사를 통한 출력과 비교
Latch 대한 개념 이해
실험 분석
R-S F/F의 회로 구성
J-K f/f 을 구성
J-K F/F 대한 개념 이해
실험 분석
토글 값이 제대로 나오지 않는 이유에 대한 분
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