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하였을 때>
<4 - 2 를 동작 하였을 때> 1. 2비트 감산기
- 209페이지 Source 코드 참고
< 시뮬레이션 결과 >
< H/W 확인 >
< .ucf 파일 생성 >
< 동작 확인 >
2. 4비트 가감산기
< 시뮬레이션 결과 >
< .ucf 파일 생성 >
<동작확인>
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4비트 가감산기를 설계하면서 처음엔 어떻게 하면 4개의 가산기를 연결할 수 있는지 몰랐었으나, 조원과 머리를 맞대고 고민한 결과 수차례의 trial & error을 반복하여 입력 및 출력변수를 새로 조정하고, 임의의 signal을 만드는 방법으로 문제를
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4비트(4Bit) 가감산기(Adder & Subtracter)
실습 날짜 : 10월 4일
목적 : 4비트의 가감산기를 이해하고 회로도를 설계하여 그 기능과 수행과정을 익힌다.
회로도
＿고찰
4비트 가감산기의 설계는 위 회로도와 같이 설계가 가능하다.
4비트 가감산기의
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감산기를 별도로 설계하지 않고 가산기를 감산기로 사용한다.
<그림 1-4 반감산기>
<그림 1-5 전감산기>
가감산기 회로는 제어신호에 따라 덧셈을 수행하거나 1. 목표
2. 이론
1)반가산기
2)전가산기
3)이진병렬가산기
4)반감산
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데 2개의 Digit가 요구되므로 2개의 출력이 필요하다. 1. 설계 이론
- 반가산기 & 전가산기 & 전감산기 & 4Bit 가감산기
2. 설계 과정
① 스펙작성
② 수식화
③ 기술매핑
④ 검증
-결과파형
3. 설계 결론 ( 결과 분석 및 논의)
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