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1중 1이 홀수 개이면 결과는 1이 된다.
X
Y
C1
S
C
0
0
0
0
0
0
0
1
1
0
0
1
0
1
0
0
1
1
0
1
1
0
0
1
0
1
0
1
0
1
1
1
0
0
1
1
1
1
1
1
<진리표>
<논리회로>
S = XYC1
C = XY + (XY)C1 <논리식>
위의 논리회로에서 보듯이 전가산기는 반가산기 두 개로 이루어져 있다.
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Floating_Point_Adder
input, output, component 정의
각 단계(stage1~stage7)를 순차적으로 실행
stage_1 : Compare_Exponent
두 수의 지수를 비교 후 부호 비트, 지수 부분, 분수 부분을 결정하는 함수
두 입력 값의 지수 부분을 비교한다.
지수 부분이 큰 수를 out
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VHDL을 이용하여 소스를 코딩한다.
역시 컴파일과 타겟보드로 다운로드 후 관찰한다.
·실험에 관한 고찰
이번시간에는 전가산기에 대해서 실습을 하였다. 저번에는 소스코딩만 하여 실험하였는데 이 번실험 시간에는 회로도와 소스 두 가지
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가산기를 네가지 방식으로 구현해보았다. 게이트를 이용해 회로를 직접 그려본
schemetic, 명령어를 이용하여 손쉽게 작성할수 있는 자료흐름 모델링, 이미 구성
한 source를 불러와 상호연결시켜 하나의 프로그램을 만든 구조적 모델링, if 문을
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수 있었으나 분명 더 복잡한 회로를 다루게 된다면 이번 실험같이 주먹구구식으로 해결하지 않고 더 깔끔하고 교수님께서 원하시는 방향으로 회로를 vhdl로 구현할 수 있어야 한다는 점을 배웠다. 1. 개요
2. 디자인
3. 결론
4. 느낀점
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