Verilog HDL 가산기

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전문지식 63건

	HDL 4bit adder - Verilog HDL을 이용한 가산기 설계 : Verilog HDL 언어를 학습한... <Quartus II 사용법 및 Verilog HDL 4bit adder> 1. 실험 제목 : Verilog HDL을 이용한 가산기 설계 2. 실험 목적 - Verilog HDL 언어를 학습한다. - QuartusII 프로그램의 사용법을 익힌다. - HBE-ComboII 실습장비의 사용법을 익힌다. <Verilog HDL> Ver Quartus II 사용법 Verilog HDL 가산기, Verilog HDL 4bit adder 가산기 설계, HDL 4bit adder - Verilog HDL을 이용한 가산기 설계 : Verilog HDL 언어를 학습한다, QuartusII 프로그램의 사용법을 익,	페이지 12페이지 가격 6,300원 등록일 2015.08.25 파일종류 워드(doc) 참고문헌 없음 최근 2주 판매 이력 없음
	verilog chapter1 HDL) 중 하나인 VERILOG HDL은 아날로그 회로를 논리 합성하여 디지털 회로로 만들어 설계를 만드는 것이다. 텍스트 입력으로 이해하기 쉽고 시뮬레이션으로 결과를 예측 할 수 있는 기술이다. VERILOG HDL 이용하여 자신이 원하는 IC를 설계 및 제작, verilog, vhd, verilog발표, verilog vhd, verilog chapter1,	페이지 7페이지 가격 1,000원 등록일 2005.09.23 파일종류 한글(hwp) 참고문헌 없음 최근 2주 판매 이력 없음
	Verilog HDL을 이용한 MIPS Single Processor 설계 module control_single(opcode, RegDst, ALUSrc, MemtoReg, RegWrite, MemRead, MemWrite, Branch, ALUOp); input [5:0] opcode; output RegDst, ALUSrc, MemtoReg, RegWrite, MemRead, MemWrite, Branch; output [1:0] ALUOp; reg RegDst, ALUSrc, MemtoReg, RegWrite, MemRead, MemWrite, Branch Verilog HDL MIPS, Verilog Single, Verilog HDL을 이용한 MIPS Single Processor 설계,	페이지 17페이지 가격 2,000원 등록일 2007.11.19 파일종류 압축파일 참고문헌 없음 최근 2주 판매 이력 없음
	Quartus 디지털 시계 verilog HDL 알람기능 - 알람 기능을 가진 디지털시계 설계 - SW0 : 시계를 Set하는 신호 -> 0 : 모든 기능 정지, 1 : 동작 SW1 : view mode select signal -> 0 : Am, Pm 1시~12시, 1 : 0시~23시 SW2 : 알람 기능 on/off signal (알람은 LED를 통해 표현한다.) - [key 0] : mode selec Quartus verilog, 디지털시계 HDL, Quartus 디지털 시계 verilog HDL 알람기능,	페이지 20페이지 가격 3,000원 등록일 2009.06.14 파일종류 압축파일 참고문헌 없음 최근 2주 판매 이력 없음
	HDL programming : VHDL to Verilog (16bit myrisc processor) 목적 VHDL로 작성된 16bit myrisc processor를 참조하여 Verilog를 이용하여 설계, 구현한다. 필요성 주어진 16bit risc processor VHDL 코드를 참조하여 이번 학기 컴퓨터 구조 수업에서 배운 RISC processor과 ALU(Arithmetic Logic Unit) 등의 구조와 Pipelining등의 기술 myRISC Verilog, VHDL HDL, HDL programming : VHDL to Verilog (16bit myrisc processor),	페이지 4페이지 가격 2,000원 등록일 2006.06.29 파일종류 압축파일 참고문헌 없음 최근 2주 판매 이력 없음

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논문 1건

[논문] 해밍코드 인코더/디코더 설계 및 성능 분석

Verilog-HDL을 이용하여 설계해보고 성능을 분석해 보았다. Hamming code를 설계하기까지 많은 시행착오가 있었다. 알고리듬의 이해, Simulink 툴 사용의 미숙으로 인한 시행착오 등 이런 문제들을 해결하기 위해 인터넷에서 자료 조사와 서적을 통한

verilog|졸업논문|matlab|통신|전자|전자공학|프로젝트|설계, 해밍코드 인코더/디코더 설계 및 성능 분석,

페이지 24페이지
가격 30,000원
발행일 2009.12.08
파일종류 한글(hwp)
발행기관
저자

취업자료 3건

	[세메스자기소개서] 세메스(SW개발) 서류합격 자기소개서,세메스합격자소서 심분야 [200자] 정보과학을 전공하며 임베디드 소프트웨어 전반에 걸친 지식을 쌓을 수 있었습니다. 무선통신센서네트워크를 통한 센서 및 모터 제어기술, Verilog HDL을 이용한 반도체 설계에 관심을 두고 공부하며 SW개발자로서의 역량을 기를 세메스 자기소개서 자기소개서, 세메스 자소서, [세메스자기소개서] 세메스(SW개발) 서류합격 자기소개서,세메스합격자소서,	가격 1,900원 등록일 2013.08.25 파일종류 한글(hwp) 직종구분 일반사무직
	하이닉스 자기소개서 (2006년 최종합격) . FA팀에서 현장교육을 받으면서 MPEG 표준을 이용한 동화상 처리 기술과 이미지 센서의 기본적인 특성과 설계 방법에 대해 배울 수 있었습니다. 또한 JPEG 알고리즘을 Verilog HDL로 구현함으로써 하드웨어적인 감각도 키울 수 있었습니다. 하이닉스 자기소개서, 반도체 자소서, 하이닉스 자기소개서 (2006년 최종합격),	가격 3,000원 등록일 2007.06.29 파일종류 한글(hwp) 직종구분 전문직
	[2010년 하반기 STX엔진] 공채 서류전형 자기소개서 HDL을 조원은 F/W를 수정했습니다. 설계 SPEC은 사칙연산이었지만 나누기를 완성한 조도 없었습니다. 그렇기에 사칙 연산은 물론 제곱, 루트, 로그까지 완성한 저희 조는 독보적일 수 있었습니다. ● 장래계획 [Stay hungry, Stay foolish] 항상 배고프고 STX엔진 STX엔진 자기소개서, STX엔진 자소서 STX앤진, [2010년 하반기 STX엔진] 공채 서류전형 자기소개서,	가격 1,700원 등록일 2010.09.24 파일종류 한글(hwp) 직종구분 산업, 과학, 기술직