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다른 회로의 전가산기를 구성하라. ●실험 목적
●실험 원리
○ 반가산기 (Half-Adder, HA)
○ 전가산기 (Full-Adder, FA)
○ 반감산기 (half subtracter , HS)
○ 전감산기 (full subtractor , FS)
● 결과보고서
○ 비고 및 고찰
○ 문제
○ 고찰
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실험제목: 전가산기,감산기 결과보고서
(결과보고서)
1. 예비조사 및 실험 내용의 이해
1.1 감산기란?
반가산기, 전가산기, 이진병렬가산기는 덧셈을 수행하는 반면, 반감산기,
전감산기는 뺄셈을 수행하는 회로를 말한다. 반감산기 회로에서는
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결과 보고서에 나와 있는 진리표의 결과이다.
A0 = 0, B0 = 0, A1 = 0, B1 = 1 일 때.
A0 = 0, B0 = 1, A1 = 1, B1 = 1 일 때
A0 = 1, B0 = 0, A1 = 1, B1 = 1 일 때
A0 = 1, B0 = 1, A1 = 1, B1 = 1 일 때 (1) 실험 목적
(2) 실험 준비물
(4) 전가산기와 반가산기
(3) 예비 보고서
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출력단자를 정확히 알아두어 실습 시 실수하지 않도록 유의해야겠다. 또한 8비트의 경우도 carry의 입출력에 유의하여 실수하지 않도록 해야겠다. 1. 실험 목표
2. 실험 준비물
3. 예비 이론
4. 실험 방법 및 시뮬레이션
5. 고찰
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전가산기의 논리회로도는 그림 6과 같다.
예비보고서를 작성할 때, Max+Plus II를 사용하여 그림 6의 회로를 설계하고, 이 회로
에 대한 시뮬레이션 결과를 첨부하라.
그림 6 반가산기를 이용한 저가산기의 논리회로도
그림 6 시뮬레이션 결과
4-비
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