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다는 단점을 갖는다. 따라서 아주 고속의 연산속도가 필요한 회로에서는 Look-ahead Carry 가산기와 같은 회로가 사용된다.
<그림 1-3 4비트 이진병렬가산기>
반가산기, 전가산기, 이진병렬가산기는 덧셈을 수행하는 반면, 반감산기, 전감산기
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실험제목: 전가산기,감산기 결과보고서
(결과보고서)
1. 예비조사 및 실험 내용의 이해
1.1 감산기란?
반가산기, 전가산기, 이진병렬가산기는 덧셈을 수행하는 반면, 반감산기,
전감산기는 뺄셈을 수행하는 회로를 말한다. 반감산기 회로에서는
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반감산기
정의
반감산기(HS : half subtracter)는 2개의 1Bit 2진수 A에서 B를 빼서 그의 차(difference:D)와 자리 빌림수(borrow:Bo)를 출력하는 논리연산회로이다.
(A는 피 감수이고 B는 감수이다.) 반감산기
전감산기
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산기 및 감산기의 출력을 부울대수식으로 유도하라.
- 실험 1
S
B A
0
1
0
0
1
1
1
0
C
B A
0
1
0
0
0
1
0
1
S = A\'B + AB\' = A B C = AB
- 실험 2
S
C AB
00
01
11
10
0
0
1
0
1
1
1
0
1
0
C
C AB
00
01
11
10
0
0
0
1
0
1
0
1
1
1
S = A\'B\'C + A\'BC\' + ABC + AB\'C\' = (A\'B\' + AB)C + (A\'B + AB\')C\' =
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산기 실험회로에서 실험 결과치 표 6-7과 이론치 표 6-4를 비교하여 보자
실험치와 이론치가 일치하였다.
d=A B b=A B
(4) 그림 6-14의 전 감산기 실험회로에서 실험 결과치 표 6-8과 이론치 표 6-4를 비교 검토 해 보자.
실험치와 이론치가 일치하였다
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